昨天在知乎里面提了个问题“电子元器件存放多久后需要重新评估焊锡性,有没有标准定义?”,一天下来发现大家其实针对这个问题都没有好好的研究过,所以今天在这里好好的跟大家讨论讨论关于电子元器件在运输与存储方面的一些标准,以及标准要求。
首先,我们先聊一下研究这个问题的背景,前不久我的一位从事供应商质量管理的朋友碰到了个麻烦事情,他们SMT在打板时发现有一个批次的MOSFET发生大批量拒焊问题,所以判定为零件长期未使用造成了元器件的焊锡性失效,COB邦定加工生产,但问题是制造商并没有将相应MOS的保质期写在零件的规格书中,所以导致这位SQE也没办法判定,是否为真的过期导致。







电子线路板SMT﹨Bonding﹨后焊的加工工价标准:
1、COB 以线数算。(少于15线的,0.15元/PCS;超过15线以上的,以订单数量/PCB尺寸大小/test工位数量等参数双方再具体协调单价)
2、SMT 以单个Chip元件为单元计费,罗湖加工,价格在0.015元-0.022元之间。要看板子好不好做,难做的板子,价格相对较高。原价少于4根引脚的按一个Chip元件计算,一般将IC、接插件四只引脚算一个点,一个点就是一个元件(容阻元件CHIP)
3、Dip 后焊加工这块浮动就比较大,具体要看你跟客人协商,按产线作业员工资加上水电房租以及使用耗材(锡棒、助焊剂)等付出,除以产线一个小时的产量。在这个范围内计算。
现在后焊加工的量比较少,而且客人一般提的单价减去设备磨损跟其它支出剩下的都很少了,在者,作业员的薪水眼看是越来越高,COB邦定加工厂家,能在DIP上赚的钱很难了。

用途采用这种封装方式的芯片有两排引脚,可以直接焊在有DIP结构的芯片插座上或焊在有相同焊孔数的焊位中。其特点是可以很方便地实现PCB板的穿孔焊接,和主板有很好的兼容性。但是由于其DIP封装封装面积和厚度都比较大,而且引脚在插拔过程中很容易被损坏,可靠性较差。同时这种封装方式由于受工艺的影响,引脚一般都不超过100个。随着CPU内部的高度集成化,DIP封装很快退出了历史舞台。只有在老的VGA/SVGA显卡或BIOS芯片上可以看到它们的“足迹”。
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